поискавой системы для электроныых деталей |
|
SI3056PPT2-EVB датащи(PDF) 11 Page - Silicon Laboratories |
|
SI3056PPT2-EVB датащи(HTML) 11 Page - Silicon Laboratories |
11 / 94 page Si3056 Si3018/19/10 Rev. 1.05 11 Figure 3. Serial Interface Timing Diagram (DCE = 0) Table 7. Switching Characteristics—Serial Interface (Master Mode, DCE = 0) (VD = 3.0 to 3.6 V, TA = 0 to 70 °C, CL =20pF) Parameter Symbol Min Typ Max Unit Cycle time, SCLK tc 244 1/256 Fs — ns SCLK Duty Cycle tdty —50 — % Delay Time, SCLK ↑ to FSYNC↓ td1 —— 20 ns Delay Time, SCLK ↑ to SDO Valid td2 —— 20 ns Delay Time, SCLK ↑ to FSYNC↑ td3 —— 20 ns Setup Time, SDI Before SCLK ↓ tsu 25 — — ns Hold Time, SDI After SCLK ↓ th 20 — — ns Setup Time, FC ↑ Before SCLK↑ tsfc 40 — — ns Hold time, FC ↑ After SCLK↑ thfc 40 — — ns Note: All timing is referenced to the 50% level of the waveform. Input test levels are VIH =VD – 0.4 V, VIL =0.4 V. D15 SCLK t c t d1 V OH V OL FSYNC (mode 0) FSYNC (mode 1) t d3 t d3 16-Bit SDO 16-Bit SDI D14 D1 D0 D0 D1 D14 D15 t su t h t sfc t hfc FC t d2 D0 |
Аналогичный номер детали - SI3056PPT2-EVB |
|
Аналогичное описание - SI3056PPT2-EVB |
|
|
ссылки URL |
Конфиденциальность |
ALLDATASHEETRU.COM |
Вашему бизинису помогли Аллдатащит? [ DONATE ] |
Что такое Аллдатащит | реклама | контакт | Конфиденциальность | обмен ссыками | поиск по производителю All Rights Reserved©Alldatasheet.com |
Russian : Alldatasheetru.com | Korean : Alldatasheet.co.kr | Spanish : Alldatasheet.es | French : Alldatasheet.fr | Italian : Alldatasheetit.com Portuguese : Alldatasheetpt.com | Polish : Alldatasheet.pl | Vietnamese : Alldatasheet.vn Indian : Alldatasheet.in | Mexican : Alldatasheet.com.mx | British : Alldatasheet.co.uk | New Zealand : Alldatasheet.co.nz |
Family Site : ic2ic.com |
icmetro.com |